2021年8月30日，中國上海訊
時間：2022-04-24 11:45:01 | 來源：行業(yè)動態(tài)
時間：2022-04-24 11:45:01 來源：行業(yè)動態(tài)
國產(chǎn)EDA行業(yè)的領(lǐng)軍企業(yè)芯和半導(dǎo)體發(fā)布了前所未有的3DIC先進(jìn)封裝設(shè)計分析全流程EDA平臺。該平臺聯(lián)合了全球EDA排名第一的新思科技，是業(yè)界首個用于3DIC多芯片系統(tǒng)設(shè)計分析的統(tǒng)一平臺，為客戶構(gòu)建了一個完全集成、性能卓著且易于使用的環(huán)境，提供了從開發(fā)、設(shè)計、驗證、信號完整性仿真、電源完整性仿真到最終簽核的3DIC全流程解決方案。
隨著芯片制造工藝不斷接近物理極限，芯片的布局設(shè)計異構(gòu)集成的3DIC先進(jìn)封裝（以下簡稱3DIC）已經(jīng)成為延續(xù)摩爾定律的最佳途徑之一。3DIC將不同工藝制程、不同性質(zhì)的芯片以三維堆疊的方式整合在一個封裝體內(nèi)，提供性能、功耗、面積和成本的優(yōu)勢，能夠為5G移動、HPC、AI、汽車電子等領(lǐng)先應(yīng)用提供更高水平的集成、更高性能的計算和更多的內(nèi)存訪問。然而，3DIC作為一個新的領(lǐng)域，之前并沒有成熟的設(shè)計分析解決方案，使用傳統(tǒng)的脫節(jié)的點工具和流程對設(shè)計收斂會帶來巨大的挑戰(zhàn)，而對信號、電源完整性分析的需求也隨著垂直堆疊的芯片而爆發(fā)式增長。
芯和半導(dǎo)體此次發(fā)布的3DIC先進(jìn)封裝設(shè)計分析全流程EDA平臺，將芯和2.5D/3DIC先進(jìn)封裝分析方案Metis與新思 3DIC Compiler現(xiàn)有的設(shè)計流程無縫結(jié)合，突破了傳統(tǒng)封裝技術(shù)的極限，能同時支持芯片間幾十萬根數(shù)據(jù)通道的互聯(lián)。該平臺充分發(fā)揮了芯和在芯片-Interposer-封裝整個系統(tǒng)級別的協(xié)同仿真分析能力；同時，它首創(chuàng)了速度-平衡-精度三種仿真模式，幫助工程師在3DIC設(shè)計的每一個階段，能根據(jù)自己的應(yīng)用場景選擇最佳的模式，以實現(xiàn)仿真速度和精度的權(quán)衡，更快地收斂到最佳解決方案。
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